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Electrical Characteristics
Figure 14 shows DSI asynchronous read signals timing.
HCS
HA[11–29]
HCID[0–4]
HDST
HRW 1
HWBSn 2
100
101
112
HDBSn 1
HRDS 2
102
103
HD[0–63]
104
106
107
105
109
HTA 3
108
110
HTA 4
111
Notes:
1.
2.
3.
4.
Used for single-strobe mode access.
Used for dual-strobe mode access.
HTA released at logic 0 (DCR[HTAAD] = 0) at end of access; used with
pull-down implementation.
HTA released at logic 1 (DCR[HTAAD] = 1) at end of access; used with pull-up
implementation.
Figure 14. Asynchronous Single- and Dual-Strobe Modes Read Timing Diagram
MSC8126 Quad Digital Signal Processor Data Sheet, Rev. 15
Freescale Semiconductor
29
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